Síntesis automática de circuitos digitales con restricciones de potencia
DOI:
https://doi.org/10.70577/cn9jyt30Palabras clave:
síntesis automática, circuitos digitales, restricciones de potencia, eficiencia energética, FPGA, inteligencia artificial.Resumen
La creciente demanda de sistemas electrónicos de alto desempeño ha intensificado la necesidad de diseñar circuitos digitales con menor consumo energético, especialmente en aplicaciones como IoT, sistemas embebidos y procesamiento inteligente, donde las restricciones de potencia representan una limitación crítica. El objetivo de esta investigación fue analizar la síntesis automática de circuitos digitales bajo restricciones de potencia, evaluando su impacto en el consumo energético, el uso de recursos lógicos y el rendimiento computacional. Se aplicó una metodología cuantitativa de tipo explicativa, con diseño no experimental, basada en el análisis de 185 registros técnicos provenientes de organismos internacionales, fabricantes de semiconductores y plataformas de simulación FPGA y herramientas EDA. Se utilizaron técnicas estadísticas como correlación de Pearson, regresión lineal múltiple, ANOVA y Alfa de Cronbach.
Los principales resultados evidenciaron que los modelos de síntesis basados en inteligencia artificial redujeron el consumo energético hasta en 41.38 %, optimizaron el uso de LUTs y disminuyeron la temperatura operativa del sistema. Asimismo, se identificó una alta correlación entre el uso de recursos lógicos y el incremento del consumo energético, confirmando la influencia directa de la complejidad estructural en la eficiencia del circuito. En consecuencia, la síntesis automática con restricciones de potencia permite generar arquitecturas digitales más eficientes y sostenibles.
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